【摘 要】
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为满足无线通信中高吞吐、低功耗的要求,并行译码器的结构设计得到了广泛的关注.基于并行Turbo码译码算法,研究了前后向度量计算中的对称性,提出了一种基于前后向合并计算的高效并行Turbo码译码器结构设计方案,并进行现场可编程门阵列(field-programmable gate array,FPGA)实现.结果表明,与已有的并行Turbo码译码器结构相比,本文提出的设计结构使状态度量计算模块的逻辑资源降低50％左右,动态功耗在125 MHz频率下降低5.26％,同时译码性能与并行算法的译码性能接近.
【机 构】
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西南大学,重庆 400715;杭州电子科技大学,浙江 杭州 310018
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为满足无线通信中高吞吐、低功耗的要求,并行译码器的结构设计得到了广泛的关注.基于并行Turbo码译码算法,研究了前后向度量计算中的对称性,提出了一种基于前后向合并计算的高效并行Turbo码译码器结构设计方案,并进行现场可编程门阵列(field-programmable gate array,FPGA)实现.结果表明,与已有的并行Turbo码译码器结构相比,本文提出的设计结构使状态度量计算模块的逻辑资源降低50％左右,动态功耗在125 MHz频率下降低5.26％,同时译码性能与并行算法的译码性能接近.
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