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本文介绍一种利用数字电路,设计高可靠冗余时钟的方案.本方案特别设计了毛刺消除电路对信号的毛刺进行滤除,同时还设计了针对震荡信号特点的边沿三取二表决电路,采用分段TMR结构提高冗余时钟整体可靠性.最后,我们还针对选用FPGA的特性作了相对改动,进一步确保了方案的容错能力.
利用Actel芯片实现高可靠冗余时钟信号
【摘 要】
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本文介绍一种利用数字电路,设计高可靠冗余时钟的方案.本方案特别设计了毛刺消除电路对信号的毛刺进行滤除,同时还设计了针对震荡信号特点的边沿三取二表决电路,采用分段TMR
【机 构】
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北京交通大学电子信息工程学院
【出 处】
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电子测量与仪器学报
【发表日期】
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2004年1期
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