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本文以FPGA为平台,使用VHDL硬件描述语言设计并实现了中值滤波图像处理算法。在设计过程中,通过改进算法和优化结构,在合理地利用硬件资源的基础上,有效地挖掘出算法内在的并行性,采用流水线结构优化算法,提高了处理速度。文中提出了一种快速中值滤波算法,可以大大节省硬件资源,同时提高了处理速度。
基于FPGA的中值滤波算法研究与硬件设计
【摘 要】
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本文以FPGA为平台,使用VHDL硬件描述语言设计并实现了中值滤波图像处理算法。在设计过程中,通过改进算法和优化结构,在合理地利用硬件资源的基础上,有效地挖掘出算法内在的并
【机 构】
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长春理工大学光电工程学院
【出 处】
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长春理工大学学报(自然科学版)
【发表日期】
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2008年1期
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