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给出了一种用大规模可编程逻辑器件实现的全数字锁相环（ＤＰＬＬ）及其性能分析和具体的实现电路。
一种用可编程逻辑器件实现的全数字锁相环路
【摘 要】
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给出了一种用大规模可编程逻辑器件实现的全数字锁相环（ＤＰＬＬ）及其性能分析和具体的实现电路。
【机 构】
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哈尔滨工程大学电子工程系
【出 处】
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四川通信技术
【发表日期】
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2000年6期
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