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提出了一种同步时序逻辑电路设计的新方法-次态方程联立法.该方法从状态表中获得次态方程,然后将所获得的次态方程与所用触发器的标准次态方程联立比较而直接得到触发器的激励函数.具体设计实例表明该方法简捷、高效,对所有的同步时序逻辑电路设计均适用.
同步时序逻辑电路设计的一种新方法
【摘 要】
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提出了一种同步时序逻辑电路设计的新方法-次态方程联立法.该方法从状态表中获得次态方程,然后将所获得的次态方程与所用触发器的标准次态方程联立比较而直接得到触发器的激
【机 构】
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武汉理工大学,湖北教育学院
【出 处】
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交通与计算机
【发表日期】
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2002年6期
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