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在归纳总结现代集成电路Top-Down的设计流程的基础上,从系统的角度出发,提出电荷泵锁相环频率合成器系统参数的设计方法。并应用Matlab和Verilog-A对锁相环频率合成器系统进行建模和仿真。结果表明,系统参数满足设计要求,为晶体管级设计和物理版图设计提供坚实的基础。
CMOS锁相环频率合成器系统设计
【摘 要】
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在归纳总结现代集成电路Top-Down的设计流程的基础上,从系统的角度出发,提出电荷泵锁相环频率合成器系统参数的设计方法。并应用Matlab和Verilog-A对锁相环频率合成器系统进
【机 构】
：
武汉科技大学信息科学与工程学院,华中科技大学电子科学与技术系,中国航天科技集团九院771所
【出 处】
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武汉科技大学学报(自然科学版)
【发表日期】
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2007年5期
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