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介绍了一种应用VHDL语言设计数字锁相环的设计方法，阐明其基本工作原理和设计思想，给出了系统主要模块的设计过程和仿真结果；用可编程逻辑器件FPGA予以实现。该方案提高了DPLL的快速锁定性能，同时保证了锁定精度。
基于FPGA的数字锁相环设计
【摘 要】
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介绍了一种应用VHDL语言设计数字锁相环的设计方法，阐明其基本工作原理和设计思想，给出了系统主要模块的设计过程和仿真结果；用可编程逻辑器件FPGA予以实现。该方案提高了DPLL的
【机 构】
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天津工业大学信息与通信工程学院,河北石油职业技术学院
【出 处】
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微计算机应用
【发表日期】
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2009年1期
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