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通过对串行级联码编译码原理的研究分析,结合串行级联码在通信系统中的纠错性能仿真,从硬件实现的角度,提出了串行级联编译码器的总体实现方案.最后基于FPGA电路实现了串行级联的译码,并通过了可编程器件的验证,同时给出了在Quartus环境下的仿真波形.
基于HDTV系统的串行级联译码器设计与实现
【摘 要】
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通过对串行级联码编译码原理的研究分析,结合串行级联码在通信系统中的纠错性能仿真,从硬件实现的角度,提出了串行级联编译码器的总体实现方案.最后基于FPGA电路实现了串行级
【机 构】
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西安通信学院电子技术教研室
【出 处】
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电视技术
【发表日期】
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2003年4期
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