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以CPLD为控制核心的16位高精度数字电压表设计
以CPLD为控制核心的16位高精度数字电压表设计
来源 :半导体技术 | 被引量 : 0次 | 上传用户:bendanlxq
【摘 要】
:
介绍了基于EDA技术的智能数字电压表的实现.本系统以CPLD为控制核心,在MAX+PLUSⅡ环境下采用VHDL语言实现了数据采集、转换及显示.该系统具有集成度高、灵活性强、易于开发、
【作 者】
:
李秀梅
李学华
陆坤
【机 构】
:
成都理工大学信息工程学院
【出 处】
:
半导体技术
【发表日期】
:
2003年5期
【关键词】
:
CPLD
16位高精度数字电压表
VHDL语言
DVM
数据采集
可编程逻辑器件
CPLD
VHDL
DVM
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介绍了基于EDA技术的智能数字电压表的实现.本系统以CPLD为控制核心,在MAX+PLUSⅡ环境下采用VHDL语言实现了数据采集、转换及显示.该系统具有集成度高、灵活性强、易于开发、维护、扩展等特点.
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