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基于ACE约束的S-IRA编译码器设计
基于ACE约束的S-IRA编译码器设计
来源 :山西电子技术 | 被引量 : 0次 | 上传用户:chf012183
【摘 要】
:
考虑到结构化非规则重复累积码具有准循环的结构便于硬件实现,采用了结构化非规则重复累积码进行编码器设计。准循环矩阵的构造采用了基于ACE约束的PEG填充构造方法。结合所
【作 者】
:
刘朋利
何欢
【机 构】
:
解放军理工大学通信工程学院研究生3队,解放军理工大学通信工程学院研究生1队
【出 处】
:
山西电子技术
【发表日期】
:
2010年2期
【关键词】
:
结构化非规则重复累积码
分层修正最小和译码算法
编码器结构
译码器结构
S-IRA code
LMMSA algorithm
encoder archite
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考虑到结构化非规则重复累积码具有准循环的结构便于硬件实现,采用了结构化非规则重复累积码进行编码器设计。准循环矩阵的构造采用了基于ACE约束的PEG填充构造方法。结合所用码型的特点,设计出了简单有效的编码流程图。译码方面,采用了分层修正最小和译码算法,并设计出了译码器结构。
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