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大部分并行总线和高速串行总线的区别主要在于发送端和接收端不同的同步方式。由于其很高的复杂性，总线时钟结构成为芯片架构的最主要部分（表1）。
总线时钟结构
【摘 要】
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大部分并行总线和高速串行总线的区别主要在于发送端和接收端不同的同步方式。由于其很高的复杂性，总线时钟结构成为芯片架构的最主要部分（表1）。
【机 构】
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科利登系统有限公司
【出 处】
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中国集成电路
【发表日期】
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2006年9期
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