【摘 要】
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在MATLAB/Simulink的平台上，设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit，共9级的结构的精度不足以及4bit首级结构的功耗较大的特点，提出了一种首级3bit，共
【机 构】
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华东师范大学微电子电路与系统研究所
【基金项目】
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上海市AM基金资助(AM0508)(AM0513);上海市科委资助(06SA14)
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在MATLAB/Simulink的平台上，设计并实现了一种新的10bit Pipeline ADC的系统仿真模型。针对2bit，共9级的结构的精度不足以及4bit首级结构的功耗较大的特点，提出了一种首级3bit，共8级的结构。这种结构可以实现精度和功耗的平衡。经过系统仿真，在输入信号为10MHz，采样时钟频率为40MHz时，系统最大的SNR=60.6dB，SFDR=82.177dB。创建的系统模型可为ADC系统中的误差和静态特性研究提供借鉴。
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