32位单精度浮点乘法器的FPGA实现

来源 :现代电子技术 | 被引量 : 0次 | 上传用户：wangjuekenan

【摘要】

：

采用Verilog HDL语言,在FPGA上实现了32位单精度浮点乘法器的设计,通过采用改进型Booth算法和Wallace树结构,提高了乘法器的速度.本文使用Altera Quartus II 4.1 仿真软件,采

【作者】

：

胡侨娟仲顺安陈越洋党华

【机构】

：

北京理工大学

【出处】

：

现代电子技术

【发表日期】

：

2005年24期

【关键词】

：

浮点乘法器 BOOTH算法 WALLACE树波形仿真 floating point multiplier Booth algorithm Wallac

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采用Verilog HDL语言,在FPGA上实现了32位单精度浮点乘法器的设计,通过采用改进型Booth算法和Wallace树结构,提高了乘法器的速度.本文使用Altera Quartus II 4.1 仿真软件,采用的器件是EPF10K100EQ240-1,对乘法器进行了波形仿真,并采用0.5 CMOS工艺进行逻辑综合.

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