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△∑调制器在分数分频频率综合器中的分析与设计

来源 :半导体学报 | 被引量 : 0次 | 上传用户：wbmissing

【摘 要】

：

提出了一种适用于分数分频锁相环频率综合器的全数字噪声整型△∑调制器电路结构新的设计方法，并将其最终实现．采用了流水线技术和新的CST算法优化多位输入加法器结构，从而降低

【作 者】

：

张伟超 许俊 郑增钰 任俊彦 

【机 构】

：

复旦大学微电子学系专用集成电路与系统国家重点实验室

【出 处】

：

半导体学报

【发表日期】

：

2006年1期

【关键词】

：

△∑调制器 分数分频频率综合器 噪声整型结构 △∑ modulator fractional-N frequency synthesis MASH archit 

【基金项目】

：

上海应用材料研究与发展基金资助项目（批准号：0302）

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提出了一种适用于分数分频锁相环频率综合器的全数字噪声整型△∑调制器电路结构新的设计方法，并将其最终实现．采用了流水线技术和新的CST算法优化多位输入加法器结构，从而降低了整体的复杂度和功耗，这种电路结构通过了Matlab的行为级仿真，ASIC全定制实现并流片，该结构也通过VHDL综合实现验证，最后给出的测试结果表明该电路具有良好的性能，可应用于单片干兆赫兹级低功耗CMOS频率综合器中．

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