【摘 要】
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在数字滤波器设计与应用当中,相比于以牺牲线性相位频率特性为代价的无限冲击响应（IIR）数字滤波器,有限冲击响应（FIR）数字滤波器不仅保证了精确严格的线性相位特性,并且结构简单
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在数字滤波器设计与应用当中,相比于以牺牲线性相位频率特性为代价的无限冲击响应（IIR）数字滤波器,有限冲击响应（FIR）数字滤波器不仅保证了精确严格的线性相位特性,并且结构简单稳定。但在实现相同的设计指标时,有限冲击响应需要更高的阶数,为满足高速高阶数字滤波器设计,文章提出一种改进的分布式算法。该算法利用主流现场可编程逻辑门阵列（FPGA）芯片的多相分解结构和流水线技术,采用多路复用加法器对数据进行预相加,减少传统分布式结构的查找表规模。利用Matalb仿真设计,Quartus II编译测试,并下载到现场
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