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针对通用逻辑开发和可继承性设计提出一种动态可重构IP系统的设计方案，它主要依靠下载bits流文件改变FPGA的配置存储器来实现重构，其配置时间只与预设的IP模块大小有关，与IP的结构无关而且可以利用相关的辅助设计工具．本文介绍了该系统设计实现的流程及关键技术，并以具体实验给以验证．
一种动态可重构IP系统设计研究
【摘 要】
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针对通用逻辑开发和可继承性设计提出一种动态可重构IP系统的设计方案，它主要依靠下载bits流文件改变FPGA的配置存储器来实现重构，其配置时间只与预设的IP模块大小有关，与IP的结
【机 构】
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中国科学院国家天文台,广西工学院计算机工程系,北京科技大学信息工程学院,广西工学院电子信息与控制工程系
【出 处】
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小型微型计算机系统
【发表日期】
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2007年5期
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