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用VHDL在CPLD器件上实现一种数字频率计测频系统，能够用十进制数码管显示被测信号的频率及其他多种物理量，整个频率计设计在1块CPLD芯片上，与其他方法做的频率计相比，具有体积小、可靠性高、功耗低的特点。
基于CPLD的倒数计数器
【摘 要】
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用VHDL在CPLD器件上实现一种数字频率计测频系统，能够用十进制数码管显示被测信号的频率及其他多种物理量，整个频率计设计在1块CPLD芯片上，与其他方法做的频率计相比，具有体积小
【机 构】
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宁波大学信息科学与工程学院
【出 处】
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宁波大学学报：理工版
【发表日期】
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2007年3期
【基金项目】
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浙江省自然科学基金（X106869）.
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