【摘 要】
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在论述抗频率混叠抽取器原理的基础上,结合Altera DSP Builder开发工具,在Matlab/Simulink环境下完成了基于FPGA的抽取器的设计与实现,为数字信号处理提供了一种基于FPGA和DS
【机 构】
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大连海事大学信息工程学院,大连海事大学信息工程学院 辽宁大连116026,辽宁大连116026
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在论述抗频率混叠抽取器原理的基础上,结合Altera DSP Builder开发工具,在Matlab/Simulink环境下完成了基于FPGA的抽取器的设计与实现,为数字信号处理提供了一种基于FPGA和DSP Builder的解决方案.实验表明,多相结构是一种系统资源占用少、适合于硬件实现的高效结构.
Based on the principle of anti-frequency aliasing extractor and the development tools of Altera DSP Builder, the design and implementation of FPGA-based decimator are completed under Matlab / Simulink environment, and an FPGA-based and DSP Builder.Experiments show that multi-phase structure is a kind of efficient structure with less system resource occupation and suitable for hardware implementation.
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