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文章基于FPGA设计了一款数字钟,采用VHDL语言进行设计。系统包括分频功能、计时功能、显示译码功能和整点报时功能,并通过QuartusⅡ软件进行了仿真验证,经测试,仿真结果完全符合设计要求。系统具有稳定性好,便于修改和移植等优点。
基于FPGA的数字钟系统设计
【摘 要】
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文章基于FPGA设计了一款数字钟,采用VHDL语言进行设计。系统包括分频功能、计时功能、显示译码功能和整点报时功能,并通过QuartusⅡ软件进行了仿真验证,经测试,仿真结果完全
【机 构】
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盐城工业职业技术学院
【出 处】
：
科技创新与应用
【发表日期】
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2016年33期
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