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对于芯片处理的数据可以在其内部存储,同时又为了简化芯片的设计,可在芯片内部嵌入存储器IP核。本文设计了华虹一款EEPROM IP核的读写时序,采用Verilog语言描述,并在Model Sim SE的环境下进行仿真,实现了数据的读写。
基于一款EEPROM IP核的读写控制设计
【摘 要】
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对于芯片处理的数据可以在其内部存储,同时又为了简化芯片的设计,可在芯片内部嵌入存储器IP核。本文设计了华虹一款EEPROM IP核的读写时序,采用Verilog语言描述,并在Model Si
【机 构】
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西安邮电大学电子工程学院,西安邮电大学通信与信息工程学院,西安深亚电子有限公司
【出 处】
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中国集成电路
【发表日期】
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2014年10期
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