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数字示波器中峰值检测电路的设计采用全数字化，并在FPGA中实现。其设计思路是：把经过AD转换后的数据锁存到锁存器中，再与最大、最小值寄存器其的数据进行比较，平滑，然后把每轮采样到的数据按照一定的顺序保存到FIFO存储器。最后数据会按一定顺序从FIFO中读取出来．送往显示设备进行显示。
数字示波器中峰值检测电路的设计与仿真
【摘 要】
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数字示波器中峰值检测电路的设计采用全数字化，并在FPGA中实现。其设计思路是：把经过AD转换后的数据锁存到锁存器中，再与最大、最小值寄存器其的数据进行比较，平滑，然后把每轮采样
【机 构】
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河源职业技术学院电子信息工程系,广州民航职业技术学院通讯工程系
【出 处】
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顺德职业技术学院学报
【发表日期】
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2010年2期
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