应用VHDL语言在PLD器件上设计实现可编程计数器

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研究用 VHDL语言采用 TOP TO DOWN设计方法实现了一种可以完成二进制、十进制、可逆计数功能的可编程计数器 ;采用 MAX+PL USII集成开发环境编辑、综合、仿真 ,并下载到 PL D器件中 ,经仿真和实际电路测试 ,该计数器性能可靠。 The research uses VHDL language to design a programmable TOP TO DOWN method to achieve a programmable counter that can perform binary, decimal, reversible counting functions; MAX + PL USII integrated development environment editing, synthesis, simulation, and downloaded to PL D devices, After the simulation and the actual circuit test, the counter performance is reliable.
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