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从时分复接系统对位同步系统的性能要求出发,提出了一种基于FPGA的快速位同步系统的设计方案,给出了位同步系统的实验仿真,结果表明该系统有较快的位同步建立时间,节省了FPGA的耗用资源,系统工作稳定、可靠。
基于FPGA的快速位同步系统设计
【摘 要】
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从时分复接系统对位同步系统的性能要求出发,提出了一种基于FPGA的快速位同步系统的设计方案,给出了位同步系统的实验仿真,结果表明该系统有较快的位同步建立时间,节省了FPGA
【机 构】
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赣南师范学院电子信息学院341000江西赣州
【出 处】
：
微计算机信息
【发表日期】
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2008年5期
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