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分析了高速磁浮列车间隙信号噪声的特点，采用基于FPGA的FIR数字滤波器滤除噪声。应用基于位级联的多查找表分布式算法实现16阶低通FIR滤波器，由verilog-HDL语言完成设计文件，并在Simulink及ModelSim ISE6．1平台上进行了试验仿真，结果均满足设计要求。
高速磁悬浮列车间隙信号数字滤波器设计与实现
【摘 要】
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分析了高速磁浮列车间隙信号噪声的特点，采用基于FPGA的FIR数字滤波器滤除噪声。应用基于位级联的多查找表分布式算法实现16阶低通FIR滤波器，由verilog-HDL语言完成设计文件，并
【机 构】
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西南交通大学磁浮技术与磁浮列车教育部重点实验室
【出 处】
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电力机车与城轨车辆
【发表日期】
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2008年5期
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