基于VHDL语言的数字锁相环的设计与实现

来源 :青岛大学学报：工程技术版 | 被引量 : 0次 | 上传用户：dazhonghua988

【摘要】

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为了改善数字通信系统的同步性能,保证系统工作稳定、可靠,对锁相环电路进行了研究.在分析模拟锁相环缺点的基础上,介绍了数字锁相环的工作原理,并用VHDL语言对该系统进行了

【作者】

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董介春李万玉

【机构】

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青岛大学自动化工程学院山东青岛266071

【出处】

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青岛大学学报：工程技术版

【发表日期】

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2004年2期

【关键词】

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VHDL PLD 数字锁相环 VHDL PLD digital phase locked loop

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为了改善数字通信系统的同步性能,保证系统工作稳定、可靠,对锁相环电路进行了研究.在分析模拟锁相环缺点的基础上,介绍了数字锁相环的工作原理,并用VHDL语言对该系统进行了设计,给出了数字锁相环电路3个主要模块的设计过程及仿真结果,得到了该系统的顶层电路.实验及仿真结果表明,数字锁相环是解决同步问题的重要措施之一.

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