【摘 要】
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针对连续相位调制解调硬件实现复杂度高的问题,提出一种基于FPGA的低复杂度硬件实现方案。该方案中,调制器采用查表法,解调器采用Max-Log-MAP算法。该方案具有复杂度低、速度
【机 构】
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哈尔滨工程大学信息与通信工程学院;
【基金项目】
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“十一·五”国防预研基金资助项目(xxxx607010102)
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针对连续相位调制解调硬件实现复杂度高的问题,提出一种基于FPGA的低复杂度硬件实现方案。该方案中,调制器采用查表法,解调器采用Max-Log-MAP算法。该方案具有复杂度低、速度快、易于生成IP核等优点。利用Xilinx公司的Virtex-2Pro系列开发板,对调制解调器进行测试,验证了该系统方案的正确性。该设计可作为连续相位调制解调专用集成芯片开发的参考。
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