【摘 要】
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加法器是数字IC设计中的一个基础,其性能的好坏有时会直接影响到整个IC的性能,本文分别介绍了CRA(Carry ripple adder)、CLA(Carrylool(_ahead adder)、CSA(Carty selectadde
【机 构】
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西南交通大学信息科学与技术学院 四川·成都 610031
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加法器是数字IC设计中的一个基础,其性能的好坏有时会直接影响到整个IC的性能,本文分别介绍了CRA(Carry ripple adder)、CLA(Carrylool(_ahead adder)、CSA(Carty selectadder)和BKA(Brent-KungAdder)等几种常用架构的加法器,并用Verilog HDL语言对其进行了设计,利用常用的EDA工具,如:Modelsim、Verilog_XL、NCverilog对其做了仿真对比,分析了它们各自的面积、运算速度、功耗等性能特点。
Adder is a digital IC design basis, the performance of good or bad sometimes directly affect the performance of the entire IC, this article introduces the CRA (Carry ripple adder), CLA (Carrylool (_ahead adder), CSA (Carty selectadder) And BKA (Brent-KungAdder), and they are designed in Verilog HDL language and compared with commonly used EDA tools such as Modelsim, Verilog_XL and NCverilog, and analyzed their respective Area, computing speed, power consumption and other performance characteristics.
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