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随着集成电路特征尺寸的不断缩小，工艺偏差引起时钟偏差的不确定性，导致时钟偏差呈现出一定的统计特性。分析了哪些时钟路径可能会成为最长、最短路径，提出了一种基于电路裁剪的统计时钟偏差估计方法，可以快速估计时钟偏差的统计特性。实验结果表明，提出的算法可以在很小的精度损失下提高电路模拟的速度。
基于电路裁剪的统计时钟偏差估计方法
【摘 要】
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随着集成电路特征尺寸的不断缩小，工艺偏差引起时钟偏差的不确定性，导致时钟偏差呈现出一定的统计特性。分析了哪些时钟路径可能会成为最长、最短路径，提出了一种基于电路裁剪的
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
【出 处】
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微电子学
【发表日期】
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2007年5期
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