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基于VHDL语言的快速Reed-Solomon译码器设计

来源 :华北电力大学学报 | 被引量 : 0次 | 上传用户：yd2846996

【摘 要】

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设计了能纠正一个符号错误的RS(Reed-Solomon)译码器,给出了该译码器的VHDL模型.利用XILINX公司的Foundation Sefies 3.li集成设计环境完成了该RS译码器的VHDL源代码输入、功

【作 者】

：

李月乔 

【机 构】

：

华北电力大学电子与信息工程学院

【出 处】

：

华北电力大学学报

【发表日期】

：

2004年5期

【关键词】

：

译码器 时序仿真 VHDL语言 可编程逻辑芯片 XILINX公司 功能仿真 电路设计 XC 源代码 快速 finite fieldstandard basisV 

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设计了能纠正一个符号错误的RS(Reed-Solomon)译码器,给出了该译码器的VHDL模型.利用XILINX公司的Foundation Sefies 3.li集成设计环境完成了该RS译码器的VHDL源代码输入、功能仿真、布局与布线、时序仿真,并用XC4005EPC84可编程逻辑芯片实现了电路设计.

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