【摘 要】
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基于SMIC 0.13μm CMOS工艺,设计了一种适用于高性能流水线ADC中低抖动时钟占空比稳定器,并分析了内部电路参数变化对时钟电路性能的影响.在Cadence Spectre下仿真表明：该稳定
【机 构】
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武夷学院机电工程学院,合肥工业大学微电子昕
【基金项目】
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福建省中青年教师科研项目（JAT170589）, 武夷学院校科研基金（XD201503,XD201707）
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基于SMIC 0.13μm CMOS工艺,设计了一种适用于高性能流水线ADC中低抖动时钟占空比稳定器,并分析了内部电路参数变化对时钟电路性能的影响.在Cadence Spectre下仿真表明：该稳定器可实现20~250 MHz的有效方波输出,时钟占空比精度为（50±0.25）%,在250 MHz输入信号频率下,其均方根值抖动为56 fs,对输入时钟信号的要求低,可根据需要选择信号传输路径来节省功耗,非交叠时间可控.
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