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·可选用容量高达1Kbyte的缓冲器，令设计更具灵活性·内置锁相环路，可将输入时钟信号频率提高2、4或8倍，甚至以最高采样率操作，因此不但可以降低时钟电路方面的成本，而且还有助于简化电路设计
内置1K先进先出缓冲器及锁相环路的8位、200MSPS模拟，数字转换器
【摘 要】
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·可选用容量高达1Kbyte的缓冲器，令设计更具灵活性·内置锁相环路，可将输入时钟信号频率提高2、4或8倍，甚至以最高采样率操作，因此不但可以降低时钟电路方面的成本，而且
【出 处】
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电子技术应用
【发表日期】
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2008年2期
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