【摘 要】
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以乘法器为代表的算术运算单元是现代数字系统的核心之一,其计算速度在很大程度上影响整个芯片的运算效率.本论文提出了一种改进的Booth乘法算法,其核心思想是先移位、再压缩
【机 构】
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兰州大学信息科学与工程学院,清华大学微电子学研究所
【基金项目】
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国家自然科学基金(No.61402121,No.61073193,No.61300230),广西高校复杂系统与智能计算机重点实验室基金(No.2016CSCI05),甘肃省重点科技基金(No.1102FKDA010),甘肃省自然科学基金(No.1107RJZA188),甘肃省科技支撑计划(No.1104GKCA037)
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以乘法器为代表的算术运算单元是现代数字系统的核心之一,其计算速度在很大程度上影响整个芯片的运算效率.本论文提出了一种改进的Booth乘法算法,其核心思想是先移位、再压缩,最后求和,减少了各模块间的耦合性,有利于控制电路的简化.本论文依据纯异步电路系统的设计方法,采用“约束数据捆绑”两相握手通讯协议的Click微流水线,根据控制和数据处理分离的策略,实现了这种改进算法的8位乘法器,并在FPGA上进行了验证.在45nm工艺制程的FPGA条件下,与相同体系结构的同步乘法器相比,这种异步乘法器在面积和功耗大体相同
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