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针对高速和宽码速率的要求,在Gardner算法的基础上设计了并行码元同步模块。该模块可以满足960MHz中频采样的全数字解调器要求,适应码速率40Mbps-320Mbps,并通过了仿真验证。
高速全数字解调器的并行码元同步设计
【摘 要】
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针对高速和宽码速率的要求,在Gardner算法的基础上设计了并行码元同步模块。该模块可以满足960MHz中频采样的全数字解调器要求,适应码速率40Mbps-320Mbps,并通过了仿真验证。
【机 构】
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清华大学电子工程系
【出 处】
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微计算机信息
【发表日期】
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2008年13期
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