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高速吞脉冲程序分频器的电路设计与 PSPICE模拟
高速吞脉冲程序分频器的电路设计与 PSPICE模拟
来源 :微电子学 | 被引量 : 0次 | 上传用户:wutiepeng
【摘 要】
:
介绍了一种新的吞脉冲程序分频器的电路设计,并用0.8 μm CMOS工艺模型在微机上进行了SPICE模拟,其最高工作频率可达1.7 GHz.与一般吞脉冲程序分频器相比,具有电路简洁、高频
【作 者】
:
邝小飞
陈迪平
郭辉
朱小莉
王镇道
【机 构】
:
零陵学院,湖南大学,天津大学
【出 处】
:
微电子学
【发表日期】
:
2002年5期
【关键词】
:
吞脉冲程序分频器
CMOS
集成电路
PSPICE模拟
锁相环
Pulse swallow programmable frequency divider
CM
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介绍了一种新的吞脉冲程序分频器的电路设计,并用0.8 μm CMOS工艺模型在微机上进行了SPICE模拟,其最高工作频率可达1.7 GHz.与一般吞脉冲程序分频器相比,具有电路简洁、高频、快速的特点,可广泛应用于各种锁相频率合成器中.
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