【摘 要】
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用大多数FPGA都可以实现一个数字UWB(超宽带)脉冲发生器。本设计可以创建一个两倍于FPGA时钟频率的脉冲信号(图1)。以前的设计要采用异步延迟,才能制造出所需频率的脉冲。不
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用大多数FPGA都可以实现一个数字UWB(超宽带)脉冲发生器。本设计可以创建一个两倍于FPGA时钟频率的脉冲信号(图1)。以前的设计要采用异步延迟,才能制造出所需频率的脉冲。不过该设计需要一只支持三态上拉的FPGA,如Xilinx公司的Virtex 2(参
A digital UWB (ultra-wideband) pulse generator can be implemented with most FPGAs. This design can create a pulse signal twice the FPGA clock frequency (Figure 1). Previous designs used asynchronous delays to create the pulse of the desired frequency. However, this design requires an FPGA that supports tri-state pull-ups, such as the Virtex 2 from Xilinx
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