【摘 要】
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基于测频原理及FPGA的设计思想，给出了一种新型数字测频系统的设计方案，系统采用VHDL语言，运用自顶向下的设计思想，采取将系统按功能逐层分割的层次化设计方法。在具体实现上，以FP
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基于测频原理及FPGA的设计思想，给出了一种新型数字测频系统的设计方案，系统采用VHDL语言，运用自顶向下的设计思想，采取将系统按功能逐层分割的层次化设计方法。在具体实现上，以FPGA为中央处理器对被测频率信号进行周期采样，通过调用QuartusⅡ的宏功能模块进行占空比计算，将所得占空比数值传输给128×64的液晶显示器，实现显示被测信号占空比数值和波形的设计优化目的。硬件测试仿真结果验证了数字测频系统的有效性和可行性。
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