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对在大规模可编程逻辑器件中实现单稳态电路的方法和程序设计进行了探讨,给出了实现不可重触发和可重触发功能的单稳态电路的VHDL程序,并对所有程序进行了计算机仿真.分析了影响全数字单稳态电路定时精度的原因及解决方法.
基于VHDL的全数字单稳态电路研究
【摘 要】
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对在大规模可编程逻辑器件中实现单稳态电路的方法和程序设计进行了探讨,给出了实现不可重触发和可重触发功能的单稳态电路的VHDL程序,并对所有程序进行了计算机仿真.分析了
【机 构】
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山西大学工程学院
【出 处】
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电力学报
【发表日期】
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2005年4期
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