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[期刊论文] 作者:白丽霞,祝运嵘,陈铖颖,
来源:厦门理工学院学报 年份:2021
面向高速串行接口应用,设计一款低噪声、快速锁定的高性能锁相环电路,作为5 Gbit·s-1数据率的SerDes发射芯片的时钟源.该设计通过锁存RESET方式增加延迟时间,以减小鉴频鉴相器的死区效应,降低锁相环整体电路的杂散;其压控振荡器采用4 bit二进制开关电容的方法,......
[期刊论文] 作者:白丽霞,祝运嵘,王晴雯,杨骏,陈铖颖,祁楠,
来源:半导体技术 年份:2021
面向高速串行接口应用,设计了一款25 Gibit/s的大摆幅电压模逻辑发送器.输出驱动器由3个相同的子驱动器并联而成,且每个子驱动器都包含依据二进制权重递增的5个驱动单元,从而...
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