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[学位论文] 作者：胡孔阳,
来源：华中科技大学 年份：2012
在计算机体系结构中，处理器存取速度一直比主存存储器快的多，使处理器的高速处理能力不能充分发挥，整个系统的工作效率受到影响，因此需要设计高速缓冲存储器（Cache）以解决速度匹配......
[期刊论文] 作者：胡孔阳, 陈鹏, 桑红石,,
来源：微电子学与计算机 年份：2012
非阻塞Cache是指Cache在等待预取数据返回时，还能继续提供指令和数据．首先分析了多线程非阻塞Cache的处理器需求，然后提出其时序要求和一种实现方案．利用SystemVerilog对该方案进...
[期刊论文] 作者：胡孔阳,韩琼磊,,
来源：中国集成电路 年份：2015
本文介绍了针对高性能DSP的RapidIO控制器IP应用及集成。该控制器IP支持RapidIO标准协议版本2．2，包含完整的三层体系结构及应用层接口逻辑。控制器IP配置总线和数据总线采用标...
[期刊论文] 作者：胡孔阳,胡海生,王梓,,
来源：中国集成电路 年份：2015
本文介绍了一种结合Round-Robin,优先级可配置的多端口仲裁器设计及实现。该设计可以实现高优先级请求优先服务,相同优先级请求之间进行轮循的调度策略,同时将原子指令仲裁保...
[期刊论文] 作者：胡孔阳,胡海生,刘小明,
来源：微电子学与计算机 年份：2019
单粒子翻转(SEU,single event upset)是当高能粒子击中半导体元器件时,引起逻辑发生"0""1"改变,进而导致逻辑错误的现象.在诸如外太空等电磁辐射恶劣的环境中,芯片常常会受到...
[期刊论文] 作者：韩琼磊, 王秋实, 胡孔阳,,
来源：中国集成电路 年份：2015
本文介绍了一种应用于SOC中的PCIE控制器的设计。该PCIE控制器支持PCIE 3.0标准协议。控制器模块与片上其它逻辑模块之间的通信采用广泛应用于SOC的APB3配置接口和AXI3数据访...
[期刊论文] 作者：王媛,孙立宏,胡孔阳,
来源：中国集成电路 年份：2022
本文介绍了一种基于ALU运算单元的译码器分配电路硬件设计,利用verilog硬件描述语言实现整体设计,并利用仿真编译工具对硬件功能进行验证.该译码分配电路实现了对ALU指令行进行逻辑解析,译成各个控制字,控制ALU指令的执行.......
[期刊论文] 作者：胡孔阳, 韩琼磊, 顾大晔,,
来源：微电子学与计算机 年份：2018
针对SRIO交换器数据通路的特点,提出了一种交换器内部的互连网络设计.重点解决了实现交换网络的三个问题：1.SRIO端点与端点的跨时钟域转换;2.SRIO传输层包的组合与拆分;3.多个...
[期刊论文] 作者：胡孔阳 顾大晔 韩琼磊,
来源：电脑知识与技术 年份：2016
摘要：本文首先介绍了Cadence公司的SalvoPlus多协议SerDes的硬件结构与接口特性，SalvoPlus多协议SerDes PHY支持包括PCIe、SRIO、Ethernet、JESD204B在内的多种协议，其次介绍了SerDes与片上控制器进行系统集成的方法，最后介绍了复用多个控制器的实现方案。 关键......
[期刊论文] 作者：王媛, 刘先博, 章钰, 胡孔阳,
来源：中国集成电路 年份：2022
本文介绍了一种EMMC PHY的硬件电路设计，对该硬件电路设计进行概述，包括硬件结构框图、功能特性、可交付物，并对其关键硬件结构进行详细阐述。该硬件设计提供了3.3V/1.8V的解决方案，由数字硬件电路和模拟硬件电路两部分组成。......
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