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会议论文
应用VHDL提高RAM设计的灵活性
应用VHDL提高RAM设计的灵活性
来源 :2009年系统仿真技术及其应用学术会议(CCSSTA'2009) | 被引量 : 0次 | 上传用户:z24514516210
【摘 要】
:
本文针对应用可编程逻辑器件设计RAM时存在的资源浪费的问题,以一个具体实例展示了如何应用VHDL语言提高RAM设计的灵活性和可移植性,从而提高工程设计的效率.
【作 者】
:
韩菊
【机 构】
:
装甲兵工程学院控制工程系,北京,100072
【出 处】
:
2009年系统仿真技术及其应用学术会议(CCSSTA'2009)
【发表日期】
:
2009年期
【关键词】
:
器件设计
可编程逻辑
资源浪费
可移植性
工程设计
语言
效率
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本文针对应用可编程逻辑器件设计RAM时存在的资源浪费的问题,以一个具体实例展示了如何应用VHDL语言提高RAM设计的灵活性和可移植性,从而提高工程设计的效率.
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