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本文针对应用可编程逻辑器件设计RAM时存在的资源浪费的问题，以一个具体实例展示了如何应用VHDL语言提高RAM设计的灵活性和可移植性，从而提高工程设计的效率.
应用VHDL提高RAM设计的灵活性
【摘 要】
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本文针对应用可编程逻辑器件设计RAM时存在的资源浪费的问题，以一个具体实例展示了如何应用VHDL语言提高RAM设计的灵活性和可移植性，从而提高工程设计的效率.
【机 构】
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装甲兵工程学院控制工程系，北京，100072
【出 处】
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2009年系统仿真技术及其应用学术会议(CCSSTA'2009)
【发表日期】
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2009年期
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