【摘 要】
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本文提出了一种基于FPGA的双精度浮点FFT处理器的设计方法。通过优化操作数和旋转因子地址映射方法,每周期并行完成8个基2蝶形运算。同时本文提出了操作数的存储优化方法
【机 构】
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国防科技大学并行与分布处理重点实验室 长沙410073
【出 处】
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第十七届计算机工程与工艺年会暨第三届微处理器技术论坛
论文部分内容阅读
本文提出了一种基于FPGA的双精度浮点FFT处理器的设计方法。通过优化操作数和旋转因子地址映射方法,每周期并行完成8个基2蝶形运算。同时本文提出了操作数的存储优化方法,只要蝶形部件的流水线级数为奇数,就可以采用单个存储器存储操作数据,有效节约存储资源。整个系统采用Xilinx公司的XC6VSX475T仿真,系统频率达到了152MHz,相对于Intel(R) Core(TM)2 Quad CPU Q9400可以获得两倍左右的加速比。
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