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该文针对基于模拟的时序电路测试生成方法特点，提出了基于结构分析的电路初始化方法，及增加伪初级输出作为测试观察点和伪矢量的合理利用等作为改进时序电路测试生成效率的策略。该方法可以有效地缩短时序电路测试生成欠量长度和提高测试生成效率。针对ISCAS89一些电路的实验结果也验证了这些方法的有效性。
一种基于模拟的时序电路测试方法
【摘 要】
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该文针对基于模拟的时序电路测试生成方法特点，提出了基于结构分析的电路初始化方法，及增加伪初级输出作为测试观察点和伪矢量的合理利用等作为改进时序电路测试生成效率的策略
【机 构】
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兵工程学院电子工程系(北京)
【出 处】
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大连--香港国际计算机会议
【发表日期】
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1998年期
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