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该文论述了一个共享大（中）型计算机资源为主的教学科研终端型网络——XGDSYNET的结构设计及该网中的两个主要通信结点：集中器结点（CP）和给定终端结点。该网络基本实现高级链路控制规程（HDLC）。在硬件设计中，采用了地址译码法克服了总结对S10控制信号所造成的限制，从传输信号提取隐含的同步信息配合对时钟源的调节满足了同步通信的要求。（本刊录）