【摘 要】
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该论文设计了一个与INTEL 80C51兼容的微处理器核.论文首先对整个微处理器内核芯片进行了系统分析和设计.在分析、研究INTEL 80C51指令的基础上,设计出了一套用于微处理器内
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该论文设计了一个与INTEL 80C51兼容的微处理器核.论文首先对整个微处理器内核芯片进行了系统分析和设计.在分析、研究INTEL 80C51指令的基础上,设计出了一套用于微处理器内核的指令系统,并给出了具体的算法.接着,对微处理内核的数据路径和控制器进行了寄存器级设计,给出了ALU、SFR、计数器等部分的详细设计思路和结果.对微处理器内核的中断系统进行寄存器级设计,实现了中断、中断优先级以及串行口中断的4种工作模式.最后给出了设计中一些关键技术问题以及最后的仿真验证结果.设计中考虑了低功耗设计,以及面积、速度等因素,并在存储器地址译码电路结构上提出了新的改进.
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