高速串行协议交换机FPGA原型验证研究与实现

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目前,电子信息产业发展迅速,需要交换以及处理的数据信息量与日俱增,对交换机功能和交换网络的要求益提高。交换机SoC芯片电路功能的复杂性给芯片功能的验证工作带来了巨大的挑战,这使得传统的软件仿真工具已经无法完全解决验证的问题。而且随着越来越多的需要处理大量实时数据的应用出现,验证技术要求能够在接近实时频率的条件下进行验证,因此采用基于FPGA的原型验证方法已成为芯片正式流片前的必然选择。本文以一款光纤通道交换机SoC芯片的研制为背景,对SoC芯片基于FPGA的原型验证方法进行了重点研究,制定了交换机SoC芯片的FPGA验证方案,主要包括功能点的提取、交换机SoC芯片原型电路的实现、验证环境的搭建以及验证项的编写等。基于针对SoC设计的RTL代码,设计修改了可被FPGA芯片使用的代码(主要包括存储单元、时钟单元设计、高速通道替换、顶层封装设计等),然后进行了原型电路的FPGA器件映射,对交换机原型电路进行了综合和时序约束设计,并且对交换机原型电路进行了功能仿真验证。根据交换机SoC芯片的功能特点和需求,设计搭建了交换机芯片FPGA验证平台,编写验证项,对之前制定的交换机芯片各个功能点进行了FPGA验证,主要包括交换模块以及监控模块等模块级和系统级的验证,通过对各功能点FPGA验证结果的统计和分析,发现了虚拟仿真无法发现的设计问题,完善了交换机芯片的设计。在功能覆盖率方面,基于FPGA的交换机芯片的功能验证实现了 100%的功能覆盖率,在验证耗费的时间上,基于FPGA的验证比虚拟仿真验证时间更短,提高了交换机SoC芯片的验证效率,极大的提高了交换机SoC芯片的流片成功率。
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