HVDC引发的次同步振荡原因分析及综合阻尼抑制策略研究

来源 :华北电力大学(北京) | 被引量 : 0次 | 上传用户:jayxiandan001
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在我国能源与电力负荷分布极不均匀与电力系统互联趋势的大背景下,高压直流输电技术被广泛应用于电力系统中,由直流输电引起的次同步振荡问题也越来越引起注意,因此,为了保证汽轮发电机组安全运行,对高压直流输电(HVDC)引起的次同步振荡(SSO)问题抑制措施的研究具有相当重要的意义。论文以由HVDC引发SSO抑制措施为研究重点,首先对网侧抑制措施宽频带附加次同步阻尼控制器(SSDC)的抑制机理和设计思路进行了论述;在建立SSDC控制回路的基础上,对SSDC产生电气阻尼表达式进行了理论推导,定量揭示了SSDC的抑制能力,并给出了SSDC抑制效果影响因素与抑制能力的表达式;最后针对典型HVDC与串补外送系统在HVDC整流侧设计SSDC,并通过时域仿真对SSDC对SSO抑制的有效性及上述理论分析的正确性进行了验证。对厂侧抑制措施附加励磁阻尼控制器(SEDC)与静态无功发生器(SVG)的抑制机理和设计思路进行了论述,着重对SVG上层控制策略进行了设计;在对两种抑制措施控制回路分析的基础上,分别对SEDC与SVG产生电气阻尼表达式进行了理论推导,定量揭示两种措施的抑制能力,并给出了两种措施抑制效果影响因素抑制能力的表达式;最后针对典型HVDC与串补外送系统在厂侧设计SEDC与SVG,并通过时域仿真对SEDC、SVG对SSO抑制的有效性及上述理论分析的正确性进行了验证。在对典型系统抑制措施分析建模上,针对实际情况中可能出现的各抑制措施抑制能力不足的现象,提出了在网侧采取SSDC与在厂侧采取SEDC与SVG共同协调抑制由HVDC引起的SSO的策略;从原理上分析了SEDC与SVG在抑制SSO时的能够进行共同协调抑制的机理,并通过对电气阻尼进行理论推导提出了各抑制措施在抑制能力上的等价指标,最后通过时域仿真验证了协调抑制与抑制能力等价的正确性。
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