基于IEEE802.3ba标准下100Gb/s以太网PCS层多通道分发机制的研究与逻辑实现

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截至2010年4月,针对40G/100G以太网的IEEE802.3ba最终标准还未正式发布,但当前宽带业务对更高传输速率的需求却越来越强烈。业界中各大公司以及组织都积极参与了IEEE802.3ba标准的制定,随着芯片厂商在逻辑器件上产品性能的不断提升,使得对于40G/100G以太网设备的设计研发成为了可能。本设计的理论研究在参阅了IEEE P802.3baTM/D2.0草案标准和802.3ba相关会议文稿的基础上,对100G以太网物理层中的构架和PCS子层多通道分发机制进行了深入研究,详细分析和阐述了多通道分这一理论机制,并对20路虚通道适配10×10G,4×25G,5×20G光模块的多通道设计方案进行了详细的理论分析。本设计的逻辑实现部分为预研性质的开发设计,针对100GE接口技术中MLD & CAUI方案,根据IEEE 802.3ba草案标准提出了100G以太网物理层中PCS-MLD (Physical Coding Sublayer-Multi-lane Distrubtion)模型。PCS-MLD模型中的功能模块通过VerilogHDL硬件描述语言进行逻辑设计,选用Xilinx公司Virter-5LX330T FPGA芯片进行逻辑实现。针对上下行顶层模块下所有功能模块使用Modelsim 6.2se实现功能时序仿真,使用Xilinx ISE9.2对顶层模块进行综合,布局布线,生成下载文件。最后结合100GE样机预研项目,采用专业数据源发生器及测试仪,对100GE样机进行实际的场景测试,其测试也对PSC-MLD模型进行了真实测试。本设计对于40G/100G高速以太网研究和网络设备的设计研发具有较大的参考价值。
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