【摘 要】
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针对生产实践中对低功耗PLL的需求,该文着重阐述了如何基于BL1.2μmCMOS工艺,自上而下地设计一个低功耗模数混合的锁相环路系统的全过程,该设计以模拟电路为主.在保证良好工
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针对生产实践中对低功耗PLL的需求,该文着重阐述了如何基于BL1.2μmCMOS工艺,自上而下地设计一个低功耗模数混合的锁相环路系统的全过程,该设计以模拟电路为主.在保证良好工作性能的基础上,采用多种低功耗设计技术--改进电路结构、降低电源电压、采用多个电源电压等,降低了整个系统的功耗.文中分析了造成鉴相器死区特性的原因,采用延长PFD输出信号高电平脉冲宽度的方法,加快PFD的鉴相速度,减小了死区.为了增加电荷泵的稳定性,该次设计采用了一种低电压、高频率的新型电荷泵电路,消除了电压跳变现象.HSpice仿真结果表明,外加模拟电路电源电压3.3V,数字电路电源电压2V时,整个系统的功耗由外加电源电压5V时的18mw减少为8.2mw,降低了54.4﹪,系统性能并没有变差.
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