【摘 要】
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该论文主要分为三大部分;第一部分为绪言, 在该论文的绪方中讨论了DSP的特点,这些特点是该论文在设计DSP结构时考虑的出发点,第二部分为DSP中各组成部分的设计(包括指令集设
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该论文主要分为三大部分;第一部分为绪言, 在该论文的绪方中讨论了DSP的特点,这些特点是该论文在设计DSP结构时考虑的出发点,第二部分为DSP中各组成部分的设计(包括指令集设计、流水线设计和存储器设计),在这部分中主要是讨论一些基本的理论和一些功能的实现.第三部分是该论文的具体实现部分,在这部分里主要讨论了快速乘法器和加法器算法之后,该论文选择了采用布什算法的快速乘法器和超前进位加法器.在两部分实现中考虑了简化硬件和加快,提出了几种方法,如在乘法器中采用更正数和在加法器中利用保护位来进行条件码的产生.具体实现是用VerilogHDL语言来描述的,并在Cadence系统的Verilog_XL下进行了功能模拟和在Synopsys的DesignCompiler下进行了逻辑综合.速度达到了30MHZ,面积为1500门.在最后的附寻中该论文给出了;(1)在附录A中为四输入35位超前进位加法器的C语言描述,(2)在附录B中为四输入35位超前进位加法器的V3erilogHDL语言描述,(3)在附录C中为整个DSP在Verilog_XL下功能模拟的波形图.
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