【摘 要】
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采用流水线设计技术和模块化设计思想,提出一种基于CCSDS新推荐标准的图像数据压缩算法中二维9/7整数离散小波变换的实时并行实现结构。结构主要由行变换、列变换和行缓存等模块组成,行、列变换可并行进行。使用FPGA内嵌的BlockRAM作为行缓存器,减少了外部存储器的使用、访问以及时间延迟。结果表明,该实现结构能够减少运算量和电路规模,获得较高的吞吐率,增加硬件资源利用率,提高变换速度。
【机 构】
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山东大学,机械工程学院,济南,250061北京理工大学,光电工程系,北京,100081;
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采用流水线设计技术和模块化设计思想,提出一种基于CCSDS新推荐标准的图像数据压缩算法中二维9/7整数离散小波变换的实时并行实现结构。结构主要由行变换、列变换和行缓存等模块组成,行、列变换可并行进行。使用FPGA内嵌的BlockRAM作为行缓存器,减少了外部存储器的使用、访问以及时间延迟。结果表明,该实现结构能够减少运算量和电路规模,获得较高的吞吐率,增加硬件资源利用率,提高变换速度。
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